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Alder Lake : d’innombrables variantes du grand et petit processeur d’Intel en vue

Dans la base de données de Coreboot, diverses configurations ont été stockées pour la prochaine génération de processeurs Alder Lake d’Intel. Le nouveau modèle avec un maximum de huit grands et huit petits cœurs CPU plus unité graphique peut donc être configuré de différentes manières.

Les variantes de base sont Alder Lake-S pour le bureau et Alder Lake-P probablement pour l’environnement mobile. Les entrées dans Coreboot contiennent toujours des informations sur les aspects suivants : Nombre de grands cœurs (comme pour tous les cœurs de processeurs précédents) + nombre de petits cœurs (connus de la série Atom) + type d’unité graphique (comme les variantes GT1 et GT2).

Selon les entrées, la configuration maximale comprend, comme prévu, huit grands plus huit petits noyaux et des graphiques GT1 sur le bureau, dans le portable il devrait y avoir un maximum de six grands plus huit petits et des graphiques GT2. C’est logique, car l’économie d’énergie est davantage mise en avant ici et un graphique discret supplémentaire n’est pas absolument nécessaire. Il existe des variantes dans ces deux domaines qui se passent complètement de noyaux d’atomes.

{ PCI_DEVICE_ID_INTEL_ADL_S_ID_1, "Alderlake-S (8+8+1)" },
{ PCI_DEVICE_ID_INTEL_ADL_S_ID_2, "Alderlake-S (8+6+1)" },
{ PCI_DEVICE_ID_INTEL_ADL_S_ID_3, "Alderlake-S (8+4+1)" },
{ PCI_DEVICE_ID_INTEL_ADL_S_ID_4, "Alderlake-S (8+2+1)" },
{ PCI_DEVICE_ID_INTEL_ADL_S_ID_5, "Alderlake-S (8+0+1)" },
{ PCI_DEVICE_ID_INTEL_ADL_S_ID_6, "Alderlake-S (6+8+1)" },
{ PCI_DEVICE_ID_INTEL_ADL_S_ID_7, "Alderlake-S (6+6+1)" },
{ PCI_DEVICE_ID_INTEL_ADL_S_ID_8, "Alderlake-S (6+4+1)" },
{ PCI_DEVICE_ID_INTEL_ADL_S_ID_9, "Alderlake-S (6+2+1)" },
{ PCI_DEVICE_ID_INTEL_ADL_S_ID_10, "Alderlake-S (6+0+1)" },
{ PCI_DEVICE_ID_INTEL_ADL_S_ID_11, "Alderlake-S (4+0+1)" },
{ PCI_DEVICE_ID_INTEL_ADL_S_ID_12, "Alderlake-S (2+0+1)" },
{ PCI_DEVICE_ID_INTEL_ADL_S_ID_13, "Alderlake-S (8+6+1)" },
{ PCI_DEVICE_ID_INTEL_ADL_S_ID_14, "Alderlake-S (8+6+1)" },
{ PCI_DEVICE_ID_INTEL_ADL_S_ID_15, "Alderlake-S (8+8+1)" },
{ PCI_DEVICE_ID_INTEL_ADL_P_ID_1, "Alderlake-P (2+8+2)" },
{ PCI_DEVICE_ID_INTEL_ADL_P_ID_2, "Alderlake-P (2+4+2)" },
{ PCI_DEVICE_ID_INTEL_ADL_P_ID_3, "Alderlake-P (6+8+2)" },
{ PCI_DEVICE_ID_INTEL_ADL_P_ID_4, "Alderlake-P (6+4+2)" },
{ PCI_DEVICE_ID_INTEL_ADL_P_ID_5, "Alderlake-P (4+8+2)" },
{ PCI_DEVICE_ID_INTEL_ADL_P_ID_6, "Alderlake-P (2+4+2)" },
{ PCI_DEVICE_ID_INTEL_ADL_P_ID_7, "Alderlake-P (2+8+2)" },
{ PCI_DEVICE_ID_INTEL_ADL_P_ID_8, "Alderlake-P (2+0+2)" },
{ PCI_DEVICE_ID_INTEL_ADL_P_ID_9, "Alderlake-P (2+0+2)" },

L’entrée dans Coreboot montre également les chipsets dans leurs différentes variantes d’équipement, telles que celles actuellement communes comme B, H, Q et Z, ainsi que la solution graphique GT0, donc les processeurs avec une unité désactivée.

{ PCI_DEVICE_ID_INTEL_ADP_P_ESPI_0, "Alderlake-P-Base SKU" },
{ PCI_DEVICE_ID_INTEL_ADP_P_ESPI_1, "Alderlake-P-Super SKU" },
{ PCI_DEVICE_ID_INTEL_ADP_P_ESPI_2, "Alderlake-P Premium SKU" },
{ PCI_DEVICE_ID_INTEL_ADP_P_ESPI_3, "Alderlake-P Mainstream SKU" },
{ PCI_DEVICE_ID_INTEL_ADP_S_ESPI_0, "Alderlake-S-Base SKU" },
{ PCI_DEVICE_ID_INTEL_ADP_S_ESPI_1, "Alderlake-S-Super SKU" },
{ PCI_DEVICE_ID_INTEL_ADP_S_ESPI_2, "Alderlake-S Premium SKU" },
{ PCI_DEVICE_ID_INTEL_ADP_S_ESPI_3, "Alderlake-S Mainstream SKU" },
{ PCI_DEVICE_ID_INTEL_ADL_GT0, "Alderlake GT0" },
{ PCI_DEVICE_ID_INTEL_ADL_GT1, "Alderlake GT1" },
{ PCI_DEVICE_ID_INTEL_ADL_P_GT2, "Alderlake P GT2" },
{ PCI_DEVICE_ID_INTEL_ADL_S_GT1, "Alderlake S GT1" },

Il reste à voir dans quelle mesure toutes les variantes seront lancées sur le marché de cette manière. Avec le soutien précoce, Intel s’assure seulement que toutes les possibilités de départ sont couvertes.

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Robin Vigneron

Par Robin Vigneron

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