ISSCC 2025: Samsung prepara la NAND TLC 4xx Layer V10 con 5,6 Gb/s 7 commenti
Immagine: Samsung
La Conferenza internazionale sui circuiti a stato solido, o ISSCC 2025 in breve, inizia a febbraio. Qui troverete i dettagli tecnici sui nuovi prodotti a semiconduttori. Lo stesso vale per la NAND 3D di prossima generazione. Ciò che Samsung, SK Hynix e Kioxia stanno progettando sembra a dir poco impressionante.
Strato TLC-NAND 4xx Samsung
Mentre quest’anno l’attenzione si è concentrata sulla QLC-NAND con 28,5 Gbit/mm² (vedi foto di copertina), che offre la più alta densità d’area di NAND 3D fino ad oggi, Samsung punta a raggiungere questo obiettivo con una generazione futura con TLC e 3 bit per cella .
“28Gb/mm² 4XX-Layer 1TB 3b/cell WF-Bonding 3D-NAND Flash with 5.6Gb/s/pin IOs” è una sessione pianificata da Samsung all’ISSCC 2025. TLC -NAND con “4xx”, ovvero oltre 400 layer, dovrebbe avere quasi la stessa capacità di stoccaggio per area, pari a 28 Strati Gbit/mm² QLC NAND 286 della generazione V9, la cui produzione in serie è iniziata a settembre.
Degna di nota è anche la veloce interfaccia NAND da 5,6 Gbps per pin. I chip NAND più veloci finora in questo senso sono 3,6 Gbps.
Samsung è da tempo leader nella NAND 3D, ma negli ultimi anni è rimasta indietro e ora deve recuperare terreno. Il fatto che Samsung utilizzi per la prima volta nella produzione il wafer bonding con lo strato NAND 4xx è successo già da tempo ai suoi concorrenti. YMTC si era già fidato di lui con la sua architettura “XTacking”, Kioxia e Western Digital hanno recentemente seguito l’esempio con il loro flash BiCS8.
Il bonding dei wafer descrive una fase di produzione in cui due wafer di silicio vengono incollati insieme su tutta la superficie. Nel caso della NAND 3D, la logica del chip (I/O) e l’area di memoria vengono inizialmente realizzate separatamente su wafer separati e poi combinate per formare un chip di memoria. Anche se fossero necessarie due slice, i costi complessivi non dovrebbero aumentare, perché in questo modo la densità di stoccaggio può essere notevolmente aumentata, valendo così il costo.
Samsung dovrebbe saltare il livello 3xx
Ci sono già state voci secondo cui Samsung passerà direttamente dalla sua NAND a 286 strati della generazione V9 a oltre 400 strati, saltando così gli strati 3xx. Stavamo parlando di 430 livelli sul Samsung V10. La prevista presentazione dell’ISSCC ora supporta ulteriormente questa ipotesi.
SK Hynix ha recentemente lanciato la sua NAND TLC a 321 strati nella produzione di massa.
QLC da 2 Tbit con 321 strati di SK Hynix
Kioxia e Western Digital offrono attualmente la più alta capacità di archiviazione (non densità) nella NAND 3D con BiCS8-QLC-NAND, che ha 2 Tbit per chip. SK Hynix prevede inoltre di fornire presto questa capacità di archiviazione con la sua variante QLC di NAND a 321 strati. Si prevede inoltre che la QLC-NAND raggiunga una velocità di scrittura a livello di chip di 75 MB/s. Questo è molto veloce per l’archiviazione QLC. I 60 MB/s del BiCS6 QLC di Kioxia erano già considerati veloci due anni fa.
Una memoria 3D-NAND-Flash a 321 strati, 2 TB, 4 bit/cella con una velocità di trasmissione del programma di 75 MB/s
SK Hynix per ISSCC 2025
TLC efficace presso Kioxia
Kioxia e Western Digital puntano ancora una volta sull’efficienza energetica. La prossima sessione ISSCC è intitolata “Una memoria flash 3D da 1 TB, 3 b/cella con efficienza energetica in lettura migliorata del 29% e terminazione bassa del 4,8% e I/O isolati GB/s. » Si tratta quindi di una nuova memoria TLC con 3 bit per cella e 1 Tbit per chip, che dovrebbe funzionare il 29% in modo più efficiente durante la lettura. Resta da vedere esattamente cosa viene confrontato qui.
Argomenti: Kioxia Samsung SK Hynix Storage TLC Memoria flash NAND 3D Western Digital Fonte: ISSCC
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